Altera提供FPGA, CPLD和ASIC解决方案
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亚太2008技术巡展

主页 > 教育与活动 > 活动日程 > 活动日程 > 亚太2008技术巡展
Technology Roadshow 2008

日期: 2008年7月3日至29日

地区: 上海、南京、西安、北京、成都

议程

时间

主题

40 分钟

40-nm工艺技术的优势和挑战

50 分钟

在40 nm,采用基于收发器的FPGA进行设计

15 分钟

休息

40 分钟

当面对性能和产品及时面市挑战时,怎样推进高级数字信号处理(DSP)设计

40 分钟

在考虑下一嵌入式系统时,为什么您会想到Altera

15 分钟

Altera的创新知识产权(IP)解决方案简介

活动日程和登记

2008 Altera亚太技术巡展将在中国以下城市进行半天的活动。请联系当地的Altera代理商,登记参加研讨会。

中国

日期

城市

分销商联系信息

2008年7月3号
下午1:00 – 下午5:30

上海

文晔科技: 朱芸 Jojo Zhu
电邮: jojo.zhu@wtmec.com
电话: 86-21-5875 0858 转 5701 分机

2008年7月8号
下午1:00 – 下午5:30

南京

时代益华: 梁旻昊 Maggie Liang 
电邮: maggie.liang@achievaglobal.com
电话: 021-5308 0560 转 600 分机, 139-1724 5482

2008年7月15号
下午1:00 – 下午5:30

西安

艾睿电子: 薛隆辉 David Xue
电邮: david.xue@arrowasia.com
电话: 86-28-8620 3226 转 213 分机, 133-0822 7596

2008年7月17号
下午1:00 – 下午5:30

北京

富昌电子: 冯静 Karin Feng
电邮: karin.feng@futureelectronics.com
电话: 86-10-64182335 转 211 分机

2008年7月29号
下午1:00 – 下午5:30

成都

骏龙科技: 孙林 Sandy Sun
电邮: sandysun@cytech.com
电话: 86-28-8652 7116

摘要

40-nm工艺技术的优势和挑战

半导体供应商大步迈向更小的工艺尺寸,期望降低产品成本,提高性能,进一步增加更多的功能。Altera最近推出了FPGA业界的首款40-nm定制逻辑器件——Stratix® IV FPGA和HardCopy® IV ASIC。此次演讲介绍TSMC最新工艺技术、Altera创新收发器以及面向生产的可靠IC设计所具有的优势。

在40nm,采用基于收发器的FPGA进行设计

高速收发器在很多领域都得到了广泛应用,例如网络、电信、广播、军事、无线、工艺和存储等领域。收发器曾被认为是利基产品,只适用于对带宽要求较高的应用,例如互联网骨干基础设备等。发展趋势表明,由于市场趋向于大量采用高速串行协议,因此,收发器会普遍应用在上面提到的各个领域中。此次演讲涉及到实现高速串行协议的某些技术细节,这些协议有PCI Express、CEI-6G、串行数字接口(SDI)、千兆以太网、Serial RapidIO® (SRIO)标准、XAUI、SerialLite II、光纤通道和SONET标准。演讲还会详细介绍FPGA供应商怎样应用这些高速串行协议。

在考虑下一嵌入式系统时,为什么您会想到Altera

很少有比嵌入式系统更复杂的电子系统,其性能(图形加速的需要)、功耗、价格、灵活性和产品及时面市等问题都需要进行考虑。当面对这些挑战时,可以考虑Altera® 的嵌入式技术。Altera嵌入式技术解决方案基于Altera器件和软件,帮助您比较轻松地达到功能定制、灵活性、产品及时面市和性价比的要求。在此次技术讨论中,您将了解到为什么大量的开发人员选择了Altera嵌入式技术,还可以观看演示实例,怎样将您的系统构思迅速有效的转换为实际产品。

当面对性能和产品及时面市挑战时,怎样推进高级DSP设计

当项目要求产品及时面市时,高级数字信号处理(DSP)设计人员采用基于FPGA的DSP解决方案可以克服对DSP性能要求越来越高的设计挑战。基于FPGA的DSP系统具有高性能和产品及时面市的特性,提供并行硬件处理和高级建模技术。在此次技术讨论中,您将了解到当前的DSP发展趋势;Altera新的40-nm FPGA的DSP功能;推动DSP设计的知识产权(IP);使用The MathWorks Matlab、Simulink和Altera DSP Builder的基于FPGA的DSP设计流程;以及一个典型的转发器应用实例。

Altera的创新知识产权(IP)解决方案简介

Altera提供多种使用方便的IP内核组合。这些IP内核是高质量的“构建模块”,您可以将其置入到系统设计中,不需要花费时间从头开始进行设计。使用方便、经过预验证并且可以配置,Altera IP针对最新的Altera器件进行了优化,由Quartus II 设计软件提供全面支持。主要的第三方IP供应商面向Altera器件开发并优化了部分IP。在此次演讲中,您将了解到怎样使用这些IP内核迅速完成系统设计,降低开发成本,加速产品面市。

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