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HardCopy无缝移植工艺

Altera的HardCopy®结构化ASIC为您提供的设计过程具有FPGA的灵活性和ASIC的低成本特性,帮助您实现大批量应用。您可以采用Altera® FPGA开发设计,进行在系统测试。当您的设计经过全面测试,达到要求后,Altera HardCopy设计中心将设计无缝移植为功能等价、引脚兼容的HardCopy器件。您可以得到:

  • 从原型到大批量产品的完整方案
    • 器件、工具和知识产权(IP)
    • 原型到产品的单一供应商
  • 最小的设计风险和有保证的功能实现
    • 保留经过验证的FPGA功能——没有改动网表
    • 成熟的工艺技术(与FPGA相同)
    • 与FPGA相同的封装和引出脚
  • 较短的器件回转周期
  • 移植过程中投入的精力最少

图1显示了从FPGA设计移植为HardCopy结构化ASIC的简单“单击”设置。

图1. HardCopy移植过程

图1. HardCopy移植过程

Altera HardCopy设计中心通过以下步骤移植您的FPGA设计:

  • 从功能经过验证的FPGA设计文件中生成一个Verilog结构网表,确保符合业界标准的设计可测试(DFT)规则
  • 采用交付中提供的布置和时序约束建立设计最佳布局
  • 验证设计符合时序要求(在2至4个星期内完成设计移植和验证)
  • 采用与FPGA相同的架构和工艺技术进行原型生产

一旦原型通过验证,您对功能满意后,便可以开始批量生产。8个星期后,器件就可以发售了。

从Altera接收FPGA设计数据库开始,在大约20个星期(参见图2)内,您便能够得到产品器件。大部分客户可使用FPGA进行生产,直到发售HardCopy产品器件。

图2. HardCopy实施规划

图2. HardCopy实施规划

HardCopy NRE成本范围:

  • 130nm HardCopy Stratix® 器件,$165K至$210K
  • 90nm HardCopy II 器件,$240K至$345K

HardCopy解决方案是一种独特的总承移植过程。Altera HardCopy设计中心不需要像传统ASIC那样付出较大的投入,便可以将FPGA设计移植为HardCopy结构化ASIC:

  • 不需要专门针对ASIC时序逼近进行开发投入。Quartus® II软件适配准备了HardCopy器件时序逼近布局
  • FPGA设计完成后,不用花时间进行逻辑验证和仿真
  • 不用插入DFT逻辑,或者产生测试向量
  • 不需要购买其他的软件工具
  • 不需要重制电路板
  • 确保与进行设计开发和测试的Stratix系列FPGA引脚兼容、功能等价

Altera的无缝移植过程已经在多个设计中被采用,生产了非常成功的HardCopy结构化ASIC。所有的原型都按照上面的时间规划交付给客户,目前正在进行批量生产。

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