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主页 > 产品 > 器件 > Stratix II (和GX) > Stratix II > 特性 打印此页 订阅电邮新闻 Stratix II 器件系列特性 Altera Stratix™ II FPGA基于与Stratix器件相同的业界推崇的功能组，并有一些关键的改进。Stratix II器件具有崭新的革新性逻辑结构，它和同等的FPGA相比，在更低的成本上提供更高的性能和更大的逻辑容量。Stratix II器件具有多达180K个等效逻辑单元，是Stratix器件容量的两倍，比任何同类FPGA产品大得多。Stratix II器件拥有强大的系统级功能，具有无与伦比的设计灵活性和高性能系统集成性，如表1所列： 表1. Stratix II功能一览 功能 说明 结构性能和效率 业内最大的FPGA Stratix II FPGA采用前沿的90nm技术构建，能够提供无与伦比的密度和逻辑效率。Stratix II器件比相竞争FPGA多出5％的逻辑、50％的存储器，DSP资源多出4倍，而用户I/O多出21％。Stratix II适用于迫切需要在ASIC下单之前对设计进行验证的ASIC原型应用。 新的创新逻辑结构 Stratix II FPGA是创新逻辑体系结构的产物，与前一代产品系列相比，其性能平均快出50％，而逻辑占用降低25％。 Stratix II及Stratix器件的差别 Stratix II架构是业界最快的FPGA架构，在极其成功的Stratix架构之上提供了先进的功能，而且还具有其它功能如新的逻辑结构、带动态相位调整（DPA）电路的源同步信号和采用配置比特流加密技术的设计安全技术。 源同步信号、高I/O带宽和高速接口 Stratix II器件中的源同步信号I/O标准 Stratix II器件具有152个接收机和156个发送机通道，支持高达1Gbps数据传送速率的源同步信号。 Stratix II DPA  Stratix II器件具有嵌入 DPA 电路，消除了使用源同步信号技术长距离传送信号时由偏移引发的相位对齐问题从而简化了印刷电路板（ PCB ）布局。 差分I/O支持  Stratix II FPGA支持高达1Gbps的高速差分I/O信号，满足新兴接口包括LVDS、LVPECL和HyperTransport™标准的高性能需求。 Stratix II器件中的单端I/O标准 Stratix II器件支持现今对系统需求很严格的大带宽、单端I/O接口标准（SSTL、HSTL、PCI和PCI-X）的需求。 源同步协议 Stratix II器件支持多种高速接口标准（SPI-4.2、SFI-4、10G以太网XSBI、HyperTransport、RapidIO™、NPSI以及UTOPIA IV)，具有高度的灵活性和快速的面市时间。 设计安全 Stratix II器件中的设计安全性 Stratix II器件采用128位高级加密标准（AES）算法对配置比特流进行加密，支持设计安全性。 大存储带宽和高速外部存储器接口 Stratix II器件中的TriMatrix存储器 Stratix II FPGA中的TriMatrix存储器具有多达9Mbit的RAM。这种先进的存储结构包括三种大小的嵌入存储器块――M512、M4K和M-RAM块，可配置支持多种特性。 Stratix II器件中的外部存储接口 Stratix II器件提供先进的外部存储接口，允许设计者将外部大容量SRAM和DRAM器件集成到复杂系统设计中，而不会降低数据存取的性能。 高性能数字信号处理 Stratix II DSP块 Stratix II器件包括高性能的嵌入DSP块，它能够运行在370MHz，并为DSP应用进行优化。DSP块消除了大计算量应用中的性能瓶颈，提供可预测和可靠的性能，这样既节省资源又不会损失性能。 Stratix II器件中的DSP性能 Stratix II器件具有比DSP处理器更大的数据处理能力，实现最大的系统性能。 Stratix II器件中的软核乘法器 Stratix II器件提供了灵活实现的软核处理器，它可以配置成不同的数据宽度和延迟。软核乘法器除了提供DSP块外还具有非常高的DSP吞吐量。 系统时钟管理 Stratix II时钟管理电路 每个Stratix II器件具有多达16个高性能的低偏移全局时钟，它可以用于高性能功能或全局控制信号。另外，每个区域八个本地（区域）时钟将任何区域的时钟总数增加至24个。这种高速时钟网和充裕的PLL紧密配合，确保最复杂的设计能够运行在优化性能和最小偏移的时钟下。 Stratix II时钟管理特性 Stratix II器件具有多达12个可编程PL，具有健全的时钟管理和频率合成能力，实现最大的系统性能。PLL具有高端功能，包括时钟切换、PLL重配置、扩频时钟、频率综合、可编程相位偏移、可编程延迟偏移、外部反馈和可编程带宽。这些功能运行设计者管理Stratix II器件内外的系统时序。 片内匹配 Stratix II器件中的片内匹配 Stratix II器件具有串行和差分片内匹配，使得印刷电路板（PCB）所需的外部电阻数量最少，从而简化电路板布局。 远程系统升级功能 使用Stratix II FPGA远程升级系统 Stratix II器件具有远程系统升级功能，允许无差错地从远程安全和可靠地升级系统。 自动循环冗余码（CRC）校验 CRC Stratix II器件具有自动的32位CRC校验。在Quartus® II 软件中进行简单的单击便可以设置、激活器件内置的CRC校验器。这是单事件出错（SEU）最具成本效益的FPGA解决方案。 嵌入式软核处理器 Stratix II器件和Nios® II处理器 Stratix II器件高级架构特性结合Nios II嵌入处理器具有无与伦比的处理能力，满足网络、电信、DSP应用、大容量存储和其它高带宽系统的需求。Stratix II器件改善了最新Nios II处理器的整体系统性能。 低成本批量成品器件 HardCopy® II器件 HardCopy系列已扩展到支持Stratix II FPGA至HardCopy II 结构化ASIC的移植。HardCopy II 结构化ASIC可提供有保证的操作和业界标准工具流程支持，是业界最完整的ASIC解决方案。 给本页评分   下一步 观看网播 下载软件 参加培训 获取参考设计 支持 获取器件支持 进入Altera论坛 获取管脚文件 文档 获取文档资料 获取手册 获取数据手册 订阅电邮新闻 获取产品目录

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