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Quartus II 验证与仿真

Quartus® II 软件提供最先进的 CPLD 、 FPGA 和结构化 ASIC 验证支持。除了能够与所有一流的第三方验证工具和方法集成使用之外, Quartus II 软件还提供:

  • TimeQuest 时序分析器,这一使用方便的 ASIC 功能时序分析工具能够自然地支持 SDC。建议所有新的 90nm 设计和所有 65nm 设计都使用 TimeQuest 时序分析器。
  • 结合 PowerPlay 功耗分析和优化技术,进行综合功耗分析。
  • 芯片规划器 ( 平面布局和芯片编辑器 ) 和在系统存储器内容编辑器,迅速实现在系统设计修改。
  • SignalTap® II 嵌入式逻辑分析器 ( 由渐进式编译功能提供支持,加速验证过程。)
  • 系统资源和探测器,使用户能够在运行的时段进行设计和内部节点采样
  • SignalProbe 和逻辑分析接口

在当今基于团队的工作环境中,可编程芯片系统 (SOPC) 设计必须面对各种结合了硬件、嵌入式软件和高速 I/O 系统的验证问题。 SOPC 设计团队通常包括可编程逻辑器件 (PLD) 硬件工程师、板级硬件工程师和软件工程师团队——他们都有各自的验证要求。 Quartus II 软件现在为 SOPC 方案和传统的 PLD 硬件设计提供了最全面的验证方案。表 1 简要介绍了 Quartus II 软件验证方案。Quartus II 验证方法对所支持的验证功能进行了说明。

表1.Quartus II软件验证解决方案
验证方法 说明 Quartus II 软件支持
或订户支持
第三方支持
设计规则检查 在进行综合或fitting之前对设计以及编程风格进行检查,防止在综合、仿真或设计移植中出现任何的问题
  • Quartus II 软件到HardCopy® 器件移植设计规则检查
  • Synopsys: Leda
功能验证 在fitting之前检查设计是否符合功能方面的要求
  • Aldec: Active HDL, Rivera
  • Cadence: Incisive, NC Desktop Family
  • Mentor Graphics®: ModelSim Tool
  • Synopsys: VCS, Scirrocco
仿真激励的生成 缩短原来手动生成测试向量所需时间
  • 从波形向仿真激励文件转换器
  • 仿真激励模板生成器
 
静态时序分析 fitting后对设计性能进行分析、调试和验证
  • Quartus II 静态时序分析仪
  • Synopsys: PrimeTime
时序仿真 fitting之后进行细致的门级时序仿真
  • Cadence: NC-Verilog, NC-VHDL
  • Mentor Graphics: ModelSim
  • Synopsys: VCS, Scirrocco
硬件或软件协同仿真 快速地进行PLD硬件、嵌入式处理器、存储器和外设之间的交互仿真
  • Mentor Graphics: ModelSim
在系统验证 在系统和以系统速度报告内部节点的工作情况
  • Synplicity: Identify
板级时序分析 验证PLD和整个电路板是否满足系统时序要求

 

  • Mentor Graphics: Tau
信号完整性分析
和电磁兼容性
(EMC)
验证高速I/O信号能够可靠传送和符合EMC规则
  • Quartus II软件专用的IBIS模型生成
  • Cadence: SpectraQuest
  • Mentor Graphics: Interconnectix, XTK, Hyperlynx
  • Synopsys: Hspice
形式验证 用户不必建立任何测试矢量识别原始寄存器传输级(RLT)网表和布局布线后网表的差别

 

  • Cadence: Conformal LEC
  • Synopsys: Formality
功率估计 根据用户的设计操作特性,估算器件的功耗。Quartus II PowerPlay功率分析器可以读入所列出的来自第三方工具的VCD格式文件。
  • Cadence: NC-SIM
  • Mentor Graphics: ModelSim
  • Synopsys: VCS

第三方验证支持

Quartus II 软件用户可以使用一系列的第三方验证工具。Altera和提供硬件描述语言(HDL)仿真、设计规则检查器、静态时序分析、形式验证和信号完整性分析的第三方公司之间紧密合作,确保Quartus II 软件用户从各种最新的验证工具和方法中受益。EDA合作伙伴页面中提供了支持Altera器件的第三方EDA供应商的完整列表。

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